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Altium檢查遺漏封裝的小技巧
2011/11/23 16:12:31
Altium檢查遺漏封裝的小技巧分享：Altium檢查遺漏封裝的小技巧。高版本的Altium在這方面的操作更簡單了，通過【Footprint Manager】可以很方便的查找封裝是否遺漏,?！綯ools】->【Footprint Manager】我們只需查看【Current Footprint】，若遺漏,，很明顯就能看出來。通過右側(cè)的【Add】按鈕可以很方便的添加封裝。我們在繪制原理圖庫的時(shí)候,，有時(shí)候會(huì)填寫多個(gè)封裝。
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單列直插式封裝(SIP)是什么意思
2011/11/22 16:50:05
單列直插式封裝(SIP)是什么意思,。SIP封裝并無一定型態(tài),，就芯片的排列方式而言，SIP可為多芯片模塊(Multi-chip Module,；構(gòu)成SIP技術(shù)的要素是封裝載體與組裝工藝,。目前SIP技術(shù)尚屬初級階段，雖有大量產(chǎn)品采用了SIP技術(shù)，其封裝的技術(shù)含量不高,，系統(tǒng)的構(gòu)成與在PCB上的系統(tǒng)集成相似,，無非是采用了未經(jīng)封裝的芯片通過COB技術(shù)與無源器件組合在一起，系統(tǒng)內(nèi)的多數(shù)無源器件并沒有集成到載體內(nèi),，而是采用SMT分立器件,。
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常用元件的電氣圖形封裝形式
2011/11/22 16:40:29
常用元件的電氣圖形封裝形式常用元件的電氣圖形封裝形式。引腳封裝形式：無極性電容為RAD-0.1到RAD-0.4,，有極性電容為RB.2/.4到RB.5/1.0,，4.二極管原理圖中常用的名稱為DIODE（普通二極管）、DIODE SCHOTTKY（肖特基二極管）5.引腳封裝形式：DIODE0.4和DIODE 0.7;SOIC(small out-line integrated circuit) —— 雙側(cè)引腳小外形封裝集成電路QFP(Quad Flat Pockage) —— 四側(cè)引腳扁平封裝,。
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mm和mil的轉(zhuǎn)化
2011/11/21 19:38:58
mm和mil的轉(zhuǎn)化,。
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0805封裝尺寸/0402封裝尺寸/0603封裝尺寸/1206封裝尺寸
2011/11/21 19:34:45
0805封裝尺寸/0402封裝尺寸/0603封裝尺寸/1206封裝尺寸。封裝尺寸與功率關(guān)系： 0201 1/20W 0402 1/16W 0603 1/10W 0805 1/8W 1206 1/4W 封裝尺寸與封裝的對應(yīng)關(guān)系,。0402=1.0mmx0.5mm 0603=1.6mmx0.8mm 0805=2.0mmx1.2mm 1206=3.2mmx1.6mm 1210=3.2mmx2.5mm 1812=4.5mmx3.2mm 2225=5.6mmx6.5mm.
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Altium Designer-PCB設(shè)計(jì)入門
2011/11/15 15:36:47
Altium Designer-PCB設(shè)計(jì)入門Altium Designer-PCB設(shè)計(jì)入門,。作為本章的開始，先來創(chuàng)建一個(gè)PCB工程： 圖6-1 PCB工程的創(chuàng)建1.選擇File>>New>>Project>>PCB Project,，或在Files面板的內(nèi)New選項(xiàng)中單擊Blank Project (PCB),。圖6-12 PCB板向?qū)в肞CB向?qū)?chuàng)建一個(gè)新的PCB用的PCB向?qū)В襟E如下： 1. 創(chuàng)建一個(gè)新的PCB,，點(diǎn)擊PCB Board Wizard,，在Files底部的New from Template選項(xiàng)內(nèi)點(diǎn)擊PCB Board Wizard部分。保存已經(jīng)完成的PCB和工程文件,。
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Duplicate Net Names Wire XXX 解決辦法（轉(zhuǎn)載）
2011/11/15 10:38:08
一篇有關(guān)Altium Designer 標(biāo)識符的作用域問題的文章,，這篇文章中詳細(xì)闡述了Altium Designer中網(wǎng)絡(luò)標(biāo)識符的幾種方式：Automatic、Flat,、Global,、hierarchical四種方式，這四種方式的用法為： （1）設(shè)置為Flat方式,，不同頁之間只有Port（端口）具有全局屬性,，即在不同的sheet之間進(jìn)行同名端口的連接。（3）將不同頁之間同名netlabel修改為port,，然后通過port建立連接關(guān)系,，作用域設(shè)置為Flat或者Global或Hierarchical。
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EDA論壇-Altium designer 編譯錯(cuò)誤 “……h(huán)as no driver” ...
2011/11/15 9:43:28
EDA論壇-Altium designer 編譯錯(cuò)誤 “……h(huán)as no driver” ...終于找到問題了,，下面是解決方法,！"has no driver"的解決方法今天在進(jìn)行原理圖繪制完成后，對其進(jìn)行編譯,，發(fā)現(xiàn)出現(xiàn)好多相同的錯(cuò)誤："......has no driver",，找了很久,，沒有發(fā)現(xiàn)什么錯(cuò)誤。
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Protel中ERC錯(cuò)誤中英對照大全 | 創(chuàng)新網(wǎng)altium中文社區(qū)
2011/11/15 9:36:17
Changed net name 網(wǎng)絡(luò)名稱出現(xiàn)改變Extra net classes 出現(xiàn)多余的網(wǎng)絡(luò)類Extra nets 出現(xiàn)多余的網(wǎng)絡(luò)Extra pins in nets 網(wǎng)絡(luò)中出現(xiàn)多余的管腳Extra rules 網(wǎng)絡(luò)中出現(xiàn)多余的設(shè)計(jì)規(guī)則Net class with Extra members 網(wǎng)絡(luò)中出現(xiàn)多余的成員C：Differences associated with parameters 原理圖和PCB上有關(guān)的參數(shù)不同（共3項(xiàng)）